参加登録フォーム

セミナ参加者の定員は80名とさせていただいております。
定員を超えた場合は抽選にて選考させていただきますのであらかじめご承知ください。
また、セミナと関係ないと思われる方はお断りさせていただく場合もございますのでご了承ください。

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    (1)レセプションパーティーに参加されますか?

    (2)職務内容

    (3)RISC-Vの導入状況

    (4)SoCに搭載するAIエンジンの開発

    (5)今後必要となりそうな検証IP

    (6)ご関心のあるデザインIP

    (7)フォーマル検証

    (8)MBD上で開発されたアルゴリズムの処理時間の事前予測は重要ですか?

    (9)アナログIP (ADC, DAC, AFE)を用いたアナログチップの開発予定がありますか?

    (10)機能安全の取得は重要ですか?

    重要と回答された方への質問です。機能安全のASILはどのレベルですか?

    (11)現在HDLやSytemVerilog、UVM開発に使用されているエディタへの満足度

    (12)リントツールの導入状況

    (13)CDCの導入状況

    (14)現在システム・オン・チップ設計に取り組んでいますか、または今後6ヶ月以内に取り組む予定ですか?

    (15)あなたのSoC設計には機械学習/AIアクセラレータが必要ですか?

    (16)アクセラレータ/NPUベンダーの評価を予定されていますか、予定されている場合いつ頃開始予定ですか?

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    (17)いつ頃NPUベンダーを選定する予定ですか?

    選定予定:

    (18)IPの評価と選定におけるあなたの役割は何ですか?

    (19)NPUアクセラレータにはどの程度の性能が必要ですか?

    TOP数:

    (20)AIベンダを評価する際、独自のMLワークロードをプロファイリングしますか、それとも業界参照ベンチマークネットワークに頼りますか?

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