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カテゴリー: ニュース

SmartDVがSmartConfテストベンチ・ジェネレータを発表

さまざまな検証言語・メソドロジに対応した手書きテストベンチを自動化 カリフォルニア州サンノゼ–2020年10月6日–設計・検証向け知的財産(IP)において、高い実績と信頼を誇るSmartDV&#x…
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東芝情報システム株式会社がBlue Pearl Software社のVisual Verification Suiteを採用し、FPGA・ASICの品質の向上と開発期間の短縮を実現

  カリフォルニア州サンタクララ発-2020年9月30日-Blue Pearl Software社は、情報サービスの先進企業である東芝情報システム社が、FPGAおよびASIC開発の生産性と品質を向上させるために、Blue…
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SmartDVの設計・検証ソリューションのポートフォリオが600件を突破

製品には、デザインIP、検証IP、フォーマル検証用IP、ポスト・シリコン検証用IP、合成可能なトランザクタなどが含まれます。 カリフォルニア州サンノゼ – June 9, 2020年6月9日 –設計・検証向け知的財産(I…
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SmartDV最新規格MIPI I3C® v1.1に準拠した各種IPをリリース

新規MIPI仕様に準拠した検証/デザイン、合成可能なトランザクタ、ポストシリコン検証、SystemCの TLMとサイクル精度モデルといった一連のIPポートフォリオをリリースしました。 カリフォルニア州サンノゼ 2020年…
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SmartDVが最新規格に準拠したDDR5およびLPDDR5のデザインIPをリリース

高速で新しいデザインIPは、低消費電力、低遅延、およびゲート数の削減を実現します。 カリフォルニア州サンノゼ 2020年2月18日: デザインIPと検証IPにおいて豊富な実績と、高い信頼性をもつSmartDV&#x212…
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SLX 2019.4をリリース。本バージョンに含まれるSLX FPGAは HLSのパフォーマンスを平均45倍改善

カリフォルニア州サンノゼ-2019年12月12日-Silexica(silexica.com)は、SLX FPGA Ver.19.4をリリースしました。本バージョンでは VivadoやVitis高位合成ツール(HLS)向…
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NSITEXEがRISC-Vベースのアプリケーション向けに、SmartDVのTileLink検証IPを選択

本記事に関するご質問はネクストリームまでご連絡ください。 NSITEXEがRISC-Vベースのアプリケーション向けに、SmartDVのTileLink検証IPを選択 高効率、高品質な半導体IPの完全な検証を保証するために…
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ネクストリームがUS Agnisys社製品を取り扱い開始

ネクストリームではUS Agnisys社製品を取り扱うこととなりました。 AgnisysではWord、エクセル、IP-XACT、SystemRDL等で記載されたレジスタ情報から、合成可能なレジスタ回路、System Ve…
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SilexicaはROSCon2019でパフォーマンス テスティング プラットフォームのデモンストレーションを行いました。

本プラットフォームはROSベースの自律システムのリアルタイムパフォーマンス解析を可能にします  2019年10月21日・サンノゼ米国 ― 本日Silexica(silexica.com)はROS(ロボット オペレーティン…
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ネクストリームオフィスのご紹介

Silexicaとネクストリームのオフィスを移転しました! (↑今までのオフィスの様子) 社員同士の理解や親睦を深めるにはうってつけの狭さでしたが、デスクも椅子も隙間も足りない!そして事業拡大しまくり!! ということで、…
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